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做好的电路被“黑手”破坏?工程师也要防小人!

2018-08-17 15:04:51 Mike McNatt 阅读:
遇到任何事情进展不顺,或许可以试着以私家侦探的眼光来观察一下,是不是周遭有心怀恶意的小人…

我在1970年代大学毕业后的第二份工作,是在一家供应PCB裸板测试系统的公司;那些系统用已知良好(known-good)的板子校准,然后能为后续生产的电路板进行短路与开路(shorts and opens)测试。yhMednc

那时候我们推出了一款新版本系统,我分配到的任务是为该款高电压开路与短路测试仪器设计数字逻辑;当时没有微处理器,只有TTL (Transistor-Transistor Logic)逻辑IC,LSTTL与CMOS逻辑都还没问世,而且那家公司的系统是采用绕线板(wire-wrapped boards)──不是PCB板──来安装IC。yhMednc

我的设计有超过150颗IC,大多数是14与16接脚的DIP组件,所以完成后的原型就像是下面这张图:yhMednc

031ednc20180816yhMednc

当我开始进行电路各区域的除错,几乎每个区域都按照设计运作,除了一个关键部份;于是我熬了好几天夜试图找出问题所在,替换IC、重新为IC绕线,又移除了几个单独区域的绕线…但都行不通。我老板还有主持项目的工程师也花了好几个小时试着帮忙,终于在把所有区域都摸一遍之后,那个关键部份开始运作了,但是断断续续的。yhMednc

在周末加班也没办法解决,我周一早上进公司时沮丧得想放弃…借了一个手电筒仔细查看电路板,发现有一小段约1吋长、皱巴巴的裸绕线半塞在鼠迹网(rats nest)内;在我拿掉那条线之后,系统就开始正常运作。我终于解脱了,我的老板也很高兴,所有事情终于走向正轨。yhMednc

让我百思不得其解的是,那条线到底是从哪跑来的?最后我猜想是团队里有只「黑手」,但我一直没有找出到底是谁,而且我在那之后也完成了好几个成功的设计。而这个教训我也铭记于心:遇到任何事情进展不顺,或许可以试着以私家侦探的眼光来观察一下,是不是周遭有心怀恶意的小人想破坏你的设计…yhMednc

(原文发表于ASPENCORE旗下EDN美国版,参考链接:It's a wire-wrapped board sabotage;Judith Cheng编译)yhMednc

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  • 我也遇到过,有人会把一个电阻去掉,而且在背面。
  • 这样密密麻麻的线,也可能是自己不小心掉进去的呢?
  • 的确可能的。我就遇到过。
    周五下班调好的程序,周一上班完全不能工作。
    发现源程序的日期变成了周六的日期。
    周一一直搞到晚上11点才下班!
  • 他的怀疑是可能的。
    我也曾经遇到过。
    明明上周五调好的程序,下周一上班就不能工作了。
    然后一查源程序的时间,是周六的。
    没有办法,周一重新修改到晚上11点才下班!
  • 作者没干过装配?有机会可以看看定制设备的装配现场,里面的导线密密麻麻乱七八糟。一不小心就会掉进去导线铜丝。
  • 不要轻易怀疑他人!也可能是你自己把“这团”裸铜线不小心掉进去的呢!?我也经过接头或节点“绕线”式的“飞线连接”方式的技术年代!那种连线方式需要遵循一些原则和养成良好的接线习惯!整体接线走线布局需要通盘考虑,但是当你具体连接时:一次仅进行一根的连接操作!在布线区外面(不要在布线区上方)进行这一根线两个端头的制作(剥去导线外面的胶皮,如果是多股线要整理缕直多股线,单股线也要缕直它,导线头有氧化层还要用细砂纸轻轻地砂光滑等),制作过程中可能的杂物和下脚料(费铜线头等)千万不要掉落在布线区里面!
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